本人自已寫的一個24點的計算器 希望大家多多的幫我改正。 有什麼更好的算法，還請指點!
標簽： 家 正 算法
上傳時間： 2014-01-25
上傳用戶：z754970244
基于VHDL語言 智力搶答器的設計 本人的課程設計
標簽： VHDL 語言 搶答器
上傳時間： 2013-08-27
上傳用戶：CHINA526
vhdl基于半加器的全加器描述及仿真
標簽： vhdl 半加器 全加器 仿真
上傳時間： 2014-11-25
上傳用戶：zycidjl
用VHDL編的編碼器,具有多種功能,希望呢溫暖感跟大家共享~!
標簽： VHDL 編碼器 家
上傳時間： 2015-10-22
上傳用戶：大三三
詳細描術日用汁算器健盤輸入自動左移原理及錯誤輸入時朻正(帶符號輸入)
標簽： 輸入 自動 正 符號
上傳時間： 2015-12-28
上傳用戶：CSUSheep
上傳時間： 2014-01-24
上傳用戶：1109003457
基于VHDL的分頻器設計，這是源碼希望對大家有用。
標簽： VHDL 分頻器
上傳用戶：watch100
基于VHDL的LS138譯碼器的實現 一個很簡單的程序
標簽： VHDL 138 LS 譯碼器
上傳時間： 2016-07-25
上傳用戶：anng
這是一個利用MAX PULL 制作的VHDL的全加器的程序 如果有需要仿真圖的 請叫站長聯系我
標簽： PULL VHDL MAX 全加器
上傳時間： 2016-07-30
上傳用戶：asdkin
VHDL router16通路選擇器 基于實際模型的設計
標簽： router VHDL 16 通路
上傳用戶：stampede
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